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师奕兵
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期刊论文
合成脉冲信号延迟的一种精密控制电路设计
测试测量技术，2008，11：15～18，-0001，（）：
摘要/描述
文中提出一种基于FPGA和高速ECL器件，利用计数器和延迟线实现标准时钟信号的延迟，从而实现精密控制脉冲延迟大范围连续可调的方法。该技术可实现频率覆盖范围为50MHz～250MHz，脉冲可调延迟范围为0us～3us，分辨率为10ps的脉冲信号延迟。
【免责声明】以下全部内容由[师奕兵]上传于[2009年06月22日 10时50分58秒]，版权归原创者所有。本文仅代表作者本人观点，与本网站无关。本网站对文中陈述、观点判断保持中立，不对所包含内容的准确性、可靠性或完整性提供任何明示或暗示的保证。请读者仅作参考，并请自行承担全部责任。
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